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Langage VHDL

392 bytes added, 13:23, 21 July 2016
/* 7 Segment Display */
''In french :'' A l'aide d'une FPGA (EMP1270T144C5) et d'une carte électronique créée par l'ETML-ES, réalisation d'un schéma logique concernant l'affichage 7 segments (de 0 à F) sous Quartus.
* 4 entrées correspondant à des switch
* réalisation d'une table de vérité * simplification de la table de vérité par karnaugh et trouvé les équations logiques * réalisation du schéma logique sous Quatrus * Simulation avec Quartus
''In English :'' With an electronics board created by the ETML-ES School and equiped with a FPGA, realization of logic schemtatics concerning the 7 Segments dispaly (0 to F) under Quartus.
* 4 inputs : (switches)
* Realization of a truth table
* simplification of the truth table by Karnaugh table and found the logic equation
* Realization of logic schematics (Quartus)
* Simulation with Quartus
<gallery>
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