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Langage VHDL

364 bytes added, 20:39, 12 August 2016
/* Jongleur */
* Reset pour arrêter le jonglage
* 4 switches utilisés pour le mode de Jonglage
* PEC12 pour le choix de la vitesse (allant de 0,5 Hz à 2 Hz) => travail en cours * [EN COURS] Réalisé un compteur de 2Hz et faire tourner les segment dans le sens des aiguilles d'une montre (sens de F1 -> E1 -> A1 -> A2 -> B2 -> C1... en on recommence)
''In English :'' With an electronics board created by the ETML-ES School and equiped with a FPGA, realization / Simulation of a juggler with the both 7 Segments Display
* 4 switches used for the mode of juggling
* PEC12 to use the speed choice of juggling (to 0,5 Hz at 2 Hz)
 
=> work in progress
* [IN PROGRESS] Realized a cycle counter of 2Hz to do turned the segments in clockwise (Way: F1 -> E1 -> A1 -> A2 -> B2 -> C1... it is continuous
== Project Source ==
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